～ FPGA の柔軟性と「ロックステップ」プロセッサ・ソリューションの融合により、リスク低減と市場投入期間の短縮に寄与 ～

 

2015年11月24日

 

● 診断カバレッジが広く、安全規格に準拠した機能安全アプリケーションの開発を可能に

アルテラは本日、Nios(R) II エンベデッド・プロセッサに対応する「機能安全ロックステップ・ソリューション」の提供開始を発表いたしました。

当ソリューションは、デザイン・サイクルにおけるリスクを低減し、産業機器および自動車機能安全アプリケーションの認証取得を簡素化するもので、アルテラの FPGA、SoC、および認証済みツールフローと、機能安全におけるリーダーである YOGITECH 社 (本社：イタリア、ピサ) の IPコアを使用して、両社が共同開発したものです。

当ソリューションにより、低コスト Cyclone(R) V FPGA や MAX(R) 10 FPGA ファミリをはじめとする、アルテラ FPGA に SIL3 安全デザインの実装が容易になります。

本日からドイツのニュルンベルクで開催される 「SPS IPC Drives カンファレンス」のアルテラ・ブース (ホール 3、スタンド #270) において、このソリューションのデモを行う予定です。
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詳細は、こちらのURLからご覧いただけます。
https://www.altera.co.jp/about/news_room/releases/2015/products/nr-altera-functional-safety-yogitech.html

 

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